Siemens EDA/シーメンス EDA
IP/SoCにおける動的/静的な接続性を検証
Questa Connectivity Checkは完全自動化された動的/静的な接続チェックのためのフォーマル検証アプリです。SoC設計は小さな設計規模であってもBIST、低電力用アイソレーション回路、I/O多重化技術などにより、接続性はいっそう複雑化しています。個々のIPブロックが正しく設計されていても、その接続に誤りがあればSoCとしては正しく動作しません。接続が正しく行われていることを検証するには、従来はテストスティミュラスを作成してシミュレーションを行う必要がありましたが、組合せ数が膨大になり、かつ複雑になるに連れ、接続チェックは1つの大きな検証項目となっています。
Questa Connectivity Checkは QuestaFormalエンジンをベースに、接続チェックに特化したアプリです。RTL設計に加えて、設計仕様所の一部として存在する接続定義ファイルをCSV、IP-XACTフォーマットで読込み、接続性を検証するためのアサーションを自動生成します。フォーマルエンジンはRTLが取り得るすべてのステートに対して自動生成されたアサーションに違反しないことを数学的に証明します。従来なら週単位で行われていた検証も、時間単位で網羅的に行うことが可能です。