AMD社製品セミナー・トレーニングはAMD、または株式会社エッチ・ディー・ラボ社での開催になります。
SoC技術者のためのARM社認定アーキテクチャトレーニングはArmトレーニングパートナーとしてArm社より認定を受けているイーソル株式会社での開催になります。
AMD トレーニングコースは、AMDと、同社認定トレーニングプロバイダーの株式会社エッチ・ディー・ラボ(新横浜/大阪)にて開催しております。全てのトレーニングは、最新の技術を習得したAMD社認定トレーナーにより提供されます。
トレーニングでは、お客様の設計技術力の向上、開発する上での疑問点の解消、そして学んだことがすぐに開発現場で活かせるよう、コミュニケーションを大事にしながら、講義および演習サポートが実施されています。
AMD トレーニングコースは、TC(トレーニングクレジット)、現金、TC+現金でのお支払いが可能です。
※TC数が不足する場合、現金との併用でお支払いが可能です。
⇒4TC、8TCのコースの場合:1TC当たり13,475円(税込、現金利用によるHDLAB社特別価格)
⇒12TCのコースの場合 :不足1TC当たり11,000円(税込、現金利用によるアドバンスドコース特別価格)
カテゴリ | トレーニング名 | 開催日 | 申込締切日 |
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言語 | [Verilog] XILINX/Vivadoツールを使ったRTL設計初級 | 7/17(木)-18(金) 8/28(木)-29(金) |
7/8 8/19 |
[VHDL] XILINX/Vivadoツールを使ったRTL設計初級 | 9/18(木)-19(金) | 9/8 | |
FPGA向けRTL設計スタイルガイドセミナー | 7/22(火)-23(水) | 7/10 | |
Designing with SystemVerilog | オンデマンド 8/21(木)-22(金) |
随時 8/12 |
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検証 | Verification with SystemVerilog | 9/18(木)-19(金) | 9/8 |
カテゴリ | トレーニング名 | 開催日 | 申込締切日 |
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デバイス | 7 シリーズ FPGA デザイン | 休止中 | - |
UltraScale アーキテクチャ FPGA デザイン | 休止中 | - | |
IP | PCI Express デザイン | オンデマンド 8/21(木)-22(金) |
随時 8/12 |
Vivado初級 | Vivado Design Suite ツールフロー | 現在受付中のコースはありません | - |
Vivado Design Suiteを使用したArtix-7 FPGA設計・開発入門 | 7/24(木) | 7/14 | |
Vivado Design SuiteでのFPGA設計導入 | オンデマンド 8/5(火)-6(水) 9/18(木)-19(金) |
随時 7/25 9/8 |
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Vivado Design Suite でのタイミング制約と解析 | 8/7(木) | 7/29 | |
Vivado Design Suite でのタイミング クロージャ | 8/8(金) | 7/30 | |
Vivado ロジック解析を使用したデバッグ 基礎編 | 9/17(水) | 9/5 | |
Vivado中級 | Vivado Design Suite でのUltraFast設計手法 | 現在受付中のコースはありません | - |
Vivado Design Suite でのインプリメント手法 | 現在受付中のコースはありません | - | |
タイミングクロージャテクニックPart1 | 9/25(木) | 9/11 | |
タイミングクロージャテクニックPart2 | 9/26(金) | 9/12 | |
デザイン クロージャ テクニック デザイン&パワー | 9/24(水) | 9/10 | |
IP インテグレーターツールによる設計 | 8/19(火) | 8/7 | |
Vivado ロジック解析を使用したデバッグ テクニック | 現在受付中のコースはありません | - | |
Vivado Design Suite でのパーシャルリコンフィギュレーション | 現在受付中のコースはありません | - |
カテゴリ | トレーニング名 | 開催日 | 申込締切日 |
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エンベデッド入門 | ARTYを使用したMicroBlaze開発入門 | 現在受付中のコースはありません | - |
Zynq 7000 SoC | Zynq SoC システムアーキテクチャ | 現在受付中のコースはありません | - |
Zynq SoC エンベデッドシステム開発 | 8/26(火)-27(水) | 8/15 | |
Vitis Embedded入門 | Migrating to the Vitis Unified IDE | 7/25(金) 9/9(火) |
7/15 8/29 |
Embedded Systems Software Design Basic | 9/10(水)-11(木) | 9/1 | |
Embedded Systems Software Design OS | 9/12(金) | 9/3 | |
PetaLinuxツールを使用したエンベデッド デザイン | 現在受付中のコースはありません | - | |
Embedded Linux Development Using Yocto | 7/18(金) | 7/9 | |
Vitis Unified Software Platform |
Vitis HLSを使った高位合成 | オンデマンド | 随時 |
Vitis Model Composer | 現在受付中のコースはありません | - | |
VITISアクセラレーション開発 | 現在受付中のコースはありません | - | |
VitisAIプラットフォーム | 9/24(水)-25(木) | 9/10 |
カテゴリ | トレーニング名 | 開催日 | 申込締切日 |
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MPSoC | Zynq UltraScale+ MPSoC システムアーキテクチャ | オンデマンド 7/23(水)-24(木) |
随時 7/11 |
Zynq UltraScale+ MPSoC ハードウェアデザイン | 8/5(火)-6(水) | 7/25 | |
Zynq UltraScale+ MPSoC Boot and Platform Management | 現在受付中のコースはありません | - | |
OS and Hypervisors in Adaptive SoCs | 7/17(木)-18(金) | 7/8 | |
Zynq UltraScale+ MPSoC VCU を使ったマルチメディアソリューション | オンデマンド 8/7(木)-8(金) |
随時 7/29 |
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Kria SoM | Kria KV260 入門 | 8/1(金) | 7/23 |
Kria KV260 Vision AI | オンデマンド 8/28(木)-29(金) |
随時 8/19 |
カテゴリ | トレーニング名 | 開催日 | 申込締切日 |
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Quick Start | Versal Adaptive SoC: Quick Start | オンデマンド 9/4(木) |
随時 8/26 |
Versal AI Engine: Quick Start | 9/5(金) | 8/27 | |
Versal Adaptive SoC Workshop【講義と演習】 | 9/30(火) | 9/17 | |
Versal Adaptive SoC Workshop【演習のみ】 | 9/30(火) | 9/17 | |
Versal | Versal Adaptive SoC:アーキテクチャ | 9/9(火)-10(水) | 8/29 |
Versal Adaptive SoC:デザインメソドロジー | 9/11(木)-12(金) | 9/2 | |
Versal Adaptive SoC:ネットワーク オン チップ | 9/17(水) | 9/5 | |
Embedded Heterogeneous Design | 9/2(火)-3(水) | 8/22 | |
AI Engine | Versal AI Engine 1: アーキテクチャとデザインフロー | 現在受付中のコースはありません | - |
Versal AI Engine 2: AI エンジンカーネルを使ったグラフプログラミング | 現在受付中のコースはありません | - | |
Versal AI Engine 3: Kernel Programming and Optimization | 現在受付中のコースはありません | - |
カテゴリ | トレーニング名 | 開催日 | 申込締切日 |
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Zynq SoC エンベデッドシステムソフトウェア開発 | 休止中 | - | |
Vivado Design Suite での大規模デザインの設計手法 | 休止中 | - | |
Spartan®-6 FPGAのマイグレーション | 休止中 | - | |
7 シリーズ FPGA デザイン | 休止中 | - | |
UltraScale アーキテクチャ FPGA デザイン | 休止中 | - | |
アドバンスドエンベデッドシステムハードウェア開発 | 休止中 | - | |
アドバンスドエンベデッドシステムソフトウェア開発 | 休止中 | - | |
高速メモリインターフェイスデザイン | 休止中 | - | |
マルチギガビットシリアルI/Oを使用した設計 | 休止中 | - |