Yocto ProjectによるLinuxの作成 Vol.4~ EDFとYocto Projectの現状~
みなさま、EDF(Embedded Development Framework)の評価は進んでいますでしょうか。 評価ボード用のBuil...
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目次 はじめに フォーマル検証の成功要因 スパイラルリファインメントによるバグハント手法 ケース1:DDR3 コントローラ ケース 2:...
この記事でわかること FPGAプロジェクトにおけるPythonのテストベンチ活用実態(業界調査データをもとに解説) cocotbの仕組み...
FPGAの端子アサインを誤ると、基板完成後に設計をやり直す事態になりかねません。本記事では、基板製造前に確認できる"仮デザイン"の作り方...
GDDR7が登場し、AIや次世代ゲームの現場でメモリ性能がかつてなく注目されています。本記事では、GDDRの基本概念からGDDR1〜GD...
皆さん、こんにちは。 この記事ではRFデバイスのデータシートを初めて読む方向けに、Gain・P1dB・Noise Figureなど主要パ...
Gen5 SSDは、Gen4環境でも本当に差を出せるのか—— 本記事では、Micron NVMe Gen5 SSD 9550と前世代の9...
QuestaSimでシミュレーションを実行する際、コンパイル・オプティマイズ・シミュレーションを個別に実行していませんか? Questa...
FPGAのトランシーバー(高速シリアル)を使う際、リファレンスクロックやPch/Nchの接続を工夫することで、基板設計の最適化を行うこと...
この記事でわかること Versal のマルチブート機能の仕組みと、SD カード・QSPI フラッシュそれぞれでのブートイメージ切り替え方...
FPGAプロジェクトにおける機能検証の最大の課題は「充分なテストの作成」であるという調査結果があります。 本記事では、テストベンチやテス...
皆さんこんにちは。 この記事では、代表的なハードウェア言語の1つであるVerilog-HDLの基本的な記述方法について、数回に分けてご紹...
本記事では、AMD社のZynq™ UltraScale+™ MPSoC のPetaLinuxにユーザーアプリを実装する方法を、Vivad...
本ブログでは、前回の概要編に続き、LPDDR5/5Xの主要な機能について、「機能編」として詳しく解説していきます。 目次 LPDDR5の...
皆さん、こんにちは。FPGAの端子アサインはどうやって決めていますか? FPGA設計者が主体で決めている、回路 (基板)設計者が主体で決...
皆さま、こんにちは! 以前 Zynq™ UltraScale+™ MPSoC でのリモートアップデートについてご紹介しましたが、今回は、...
FPGA 設計において FPGA ~ DRAM 間の転送効率が期待値を大幅に下回ってしまった経験はありませんか? その大きな要因の一つが...
バックアップ電池(オンボード電池)を使用した電源OR回路では、ショットキーダイオードによる電圧降下が電池寿命に大きく影響を及ぼします。本...
本ブログでは、DDR(Double Data Rate)DRAMのモバイルデバイス向けに開発された低消費電力DDRメモリであるLPDDR...
みなさん、こんにちは!今回は、AMD社が提供しているVitis AI Tutorialをベースに、PyTorchでMNIST(手書き数字...