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【12/18開催・無料】「FPGA設計 非同期転送(CDC)問題の原因と解決策」ウェビナー ~再現性が低い/対策が極めて困難な不具合原因~

【12/18開催・無料】「FPGA設計 非同期転送(CDC)問題の原因と解決策」ウェビナー ~再現性が低い/対策が極めて困難な不具合原因~
ウェビナー

FPGA設計における大規模化、複雑化、クロックドメイン増加から非同期転送に関する問題については皆さまも感じるところがあるのではないでしょうか。

弊社でも2021年に非同期に関するウェビナーを開催したところ大きな反響があり、実際に多くのお客様とそれらの解決について取り組んで参りました。
その甲斐あってか市場調査でもFPGA設計における非同期に関する課題は改善の傾向が見られます。

しかし、依然として多くの設計で課題が残っているのも事実です。
そこで今回、近年の市場調査結果と傾向を踏まえ、非同期転送の問題の原因と対策、解決策を紹介するウェビナーを企画いたしました。

ぜひこの機会をご利用いただき、皆さまのプロジェクトにお役に立てていただければ幸いです。

アジェンダ

  • FFPGA設計における非同期転送(CDC)現状
  • 非同期転送(CDC)問題の根源「メタステーブル」
  • 非同期転送(CDC)パスに対する対策
  • 非同期転送(CDC)回路の課題と解決策

ウェビナー概要

開催日時 2025年12月18日(木)13:30~14:20(50分)
受講費用 無料
会議室などで複数名での受講をご希望される方は、人数分のお申込みが必要となります。
受講対象 ・FPGA設計者、検証エンジニア
・FPGAプロジェクトマネージャー
開催方法 ウェビナー形式(チャット機能によりリアルタイムで質疑応答可能です。)
ウェビナーツール「Zoom」を利用します。
参加方法 開催前日までにお申込みいただいた方へは、ウェビナー入場用のURLを別途メールにてお知らせいたします。
メールが届かない場合は、迷惑メールフォルダをご確認いただくか、お問い合わせフォームよりご連絡ください。
備考
競合製品取り扱い企業様のお申込みについては、お断りする場合がありますので予めご了承ください。
個人およびフリーメールアドレスによるお申込みはお断りしています。
受付締切 2025年12月17日(水)12:00

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