【4/15開催・無料】FIFO設計を通して学ぶFPGA設計の勘所 第1回
ウェビナー RTL（Verilog/VHDL）の書き方は覚えたけど、どうやって欲しい機能を実現したら良いか分からない・・・、 IPを繋い...
【4/9開催・無料】桁違いなシミュレーション高速化ソリューション紹介ウェビナー
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【3/12開催＊保守中ユーザー様限定＊】アサーションベース検証実践ウェビナー
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【3/5開催＊保守中ユーザー様限定＊】Questa Base/Coreトレーニングウェビナー③～コードカバレッジ編～
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【3/4開催＊保守中ユーザー様限定＊】初心者のためのテストベンチ記述 ～Verilog_SystemVerilog編～
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【3/3開催・無料】FPGA設計への生成AI活用の第一歩 ～生成AIと等価性検証ツールを用いたRTLリファクタリング/VHDL－Verilog変換～
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【2/26PM開催＊保守中ユーザー様限定＊】Questa Base/Coreトレーニングウェビナー②～シミュレーション・デバッグ編～
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【2/26AM開催・無料】知っていると楽しい半導体設計の世界＜後編＞〜半導体設計者のためのRTL設計の歴史と進化〜
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【2/25開催・無料】AXI検証自動化ソリューション紹介ウェビナー ～AXIバスの課題を永続的に解決する検証環境／ノウハウをご提供～
ウェビナー AXIバスは、アドレス、データ、レスポンスが分離された複雑なプロトコルです。 検証の観点として、 先行リクエスト発行、レスポ...
【2/19開催＊保守中ユーザー様限定＊】Questa Base/Coreトレーニングウェビナー①～シミュレーション・バッチ実行編～
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【2/18開催・無料】V2X（Vehicle to X）通信技術解説ウェビナー ＜前編＞ ～未来を拓く事業イノベーション創出～
ウェビナー 自動運転の普及が進む中、V2X通信は交通の安全性だけでなく、モビリティ・サービスの高度化と効率化を実現致します。本ウェビナー...
【2/12開催・無料】QuestaSim Visualizerで役立つ実践的デバッグフロー紹介ウェビナー
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【2/5開催・無料】Questa Base紹介ウェビナー ～デバッグ機能が充実したQuestaエントリーモデル～
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【2/4開催・無料】AMD社FPGA コスト重視ファミリーと長期供給ソリューション紹介ウェビナー
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【1/29開催・無料】今すぐ始められるFPGA設計資産再利用化の策 6選
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【1/27開催・無料】仕様書がない／RTLや回路図しか存在しない場合の置き換えサービス紹介ウェビナー
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【1/21開催・無料】RTLコーディングマナー～RTL設計初心者に贈るコーディングマナー集～
ウェビナー 主にRTL設計初心者を対象とし、RTL記述の際のコーディングマナーを解説します。マナーですので、守らなくても、動くコードは書...
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