2022年03月
新しい順 | 古い順
【Vivado®で使用するXDCファイルの基本的な記述例】第2回 コンフィグレーション設定、タイミング設定編
エンジニア必見!NVMeパフォーマンス測定結果公開 CPUの違いでパフォーマンスに差は出るのか!?【メモリ基礎講座 番外編】
【Versal™ACAP】MIPI Example Design【Vivado® ML 2021.1】
Vitis™ AI ver2.0がリリース!新たな機能などを紹介!
【回路設計ヒント】Microsoft Windows 10 でのiMPACT書き込み
【Versal™ACAP】Targeted Reference Design Build 2021.1版
最近の記事
タグ
- FPGA (236)
- 設計 (169)
- 検証 (81)
- Vivado (72)
- 受付終了 (48)
- 半導体 (43)
- ModelSim (43)
- AI (40)
- メモリ (26)
- Micron (26)
- MPSoC (24)
- Vitis (22)
- Vitis AI (20)
- モデルベース開発 (19)
- Versal (18)
- Simulink (16)
- QuestaSim (16)
- SSD (14)
- 電源 (12)
- サーバ/ストレージ (12)
- SystemVerilog (11)
- アナログ回路 (10)
- Nexperia (9)
- 受付中 (8)
- GPU (8)
- IoT (7)
- VoIP (7)
- MPS (7)
- ディスクリート/ロジック (6)
- アサーション (6)
- クロック (6)
- 5G (5)
- So-One (5)
- SiTime (5)
- 映像伝送 (4)
- マイコン (3)
- Microchip (3)
- 組み込みLinux (3)
- MaxLinear (3)
- CDC (3)
- イーサネット (2)
- カメラ (2)
- Haivision (2)
- ティアフォー (2)
- クラウド (2)
- シリアル通信 (2)
- Questa Lint (2)
- EOL (1)
- CPUボード (1)
- PCIe (1)





