2023年01月
新しい順 | 古い順
【企業様向けプライベートウェビナー】仕様書の書き方ウェビナー~ 失敗事例とともに仕様書を理解。仕様書の重要性、機能仕様書の書き方のポイントを伝授 ~
【企業様向けプライベートウェビナー】FPGA非同期設計ウェビナー~ 非同期設計の問題点の理解、非同期回路の設計、検証時のポイント ~
FPGA非同期設計ウェビナー~ 非同期設計の問題点の理解、非同期回路の設計、検証時のポイント ~
【FPGAテストベンチ/検証ノウハウ】DDRメモリモデルの初期値設定方法
業界最安値のGPUaaS「GPUSOROBAN」を実際に試してみた(5)~Dockerコンテナを使用し機械学習プロト環境を作る~【GPUSOROBANのベアメタルの導入編】
IBERTデザインの使用方法 【第2回】
高位合成がもたらす価値を高める高位設計/高位検証(Design and Verification LANDSCAPE 2022-Vol1)
Vivado® ML Editionで表示されるメッセージについて 【第2回】
【1/21開催・無料】RTLコーディングマナー~RTL設計初心者に贈るコーディングマナー集~
【1/15開催・無料】オペアンプで楽しく学べるアナログ・シンセサイザー ~オペアンプで簡単デザイン/アナログ回路が楽しみながら学べる~
【1/14開催・無料】コードカバレッジ機能活用のすすめ ウェビナー
【1/8開催・無料】FPGA設計の資産構築・共有化を後押しするサービスご紹介ウェビナー
【12/23開催・無料】ダイジェスト版 「AIはFPGA設計できるか?2025」~FPGA設計への生成AI活用:この1年間の進化~
【12/18PM開催・無料】「FPGA設計 非同期転送(CDC)問題の原因と解決策」ウェビナー ~再現性が低い/対策が極めて困難な不具合原因~
【12/18AM開催・無料】AMD x86 Embedded CPU 最新ロードマップウェビナー ~Advantech社様登壇!次世代組込みシステム開発の最前線~
【12/17開催*保守中ユーザー様限定*】Questa Base/Coreトレーニングウェビナー②~シミュレーション・デバッグ編~
【12/10開催*保守中ユーザー様限定*】Questa Base/Coreトレーニングウェビナー①~シミュレーション・バッチ実行編~
【12/3開催・無料】放射線に強い回路をどう作る?Precision HiRel活用事例の紹介
【11/26開催・無料】「Questa Lint紹介ウェビナー」~書いた瞬間に決まっているRTLの品質をその場で向上させるリント活用術~
最近の記事
タグ
- FPGA (237)
- 設計 (170)
- 検証 (85)
- Vivado (72)
- ModelSim (45)
- 受付終了 (44)
- 半導体 (43)
- AI (40)
- メモリ (26)
- Micron (26)
- MPSoC (24)
- Vitis (22)
- Vitis AI (20)
- モデルベース開発 (19)
- Versal (18)
- QuestaSim (18)
- Simulink (16)
- 受付中 (14)
- SSD (14)
- SystemVerilog (13)
- サーバ/ストレージ (12)
- 電源 (11)
- アナログ回路 (10)
- Nexperia (9)
- IoT (8)
- GPU (8)
- アサーション (7)
- VoIP (7)
- MPS (7)
- ディスクリート/ロジック (6)
- 5G (6)
- クロック (6)
- So-One (5)
- SiTime (5)
- 映像伝送 (4)
- CDC (4)
- マイコン (3)
- Microchip (3)
- クラウド (3)
- 組み込みLinux (3)
- MaxLinear (3)
- イーサネット (2)
- カメラ (2)
- Haivision (2)
- ティアフォー (2)
- シリアル通信 (2)
- Questa Lint (2)
- EOL (1)
- CPUボード (1)
- PCIe (1)





