FPGA
新しい順 | 古い順
FPGAの置換(Spartan®-6 FPGA ファミリ)第2回(置換可能なデバイス選定:デバイスパッケージ編)
【2/17開催】【脱!目視検査】外観検査装置による過検出問題解決AIウェビナー
FPGAの置換(Spartan®-6 FPGA ファミリ)第1回(置換可能なデバイス選定:ロジックリソース編)
モデルベースデザイン(MBD)を活用したOFDM方式ソフトウェア無線(SDR)のRFSoC実装
検証資産の再利用 – Verification IP(Design and Verification LANDSCAPE 2021-Vol2)
Xilinx社Zynq® UltraScale+™ MPSoCに複数のDPUコアを実装し各々のDPUコア上で異なるVitis™ AI Model Zooを動かしてみた
Vivado®2020.2 MPSoCプロジェクト修復の一例
【新人ブログ ミンガラバー】VHDL初級編 part.4 ~階層設計~
【ModelSim®使用方法】結果波形の比較方法
【Versal™ACAP】機能紹介 NoC Simulation編
DCモータモデルをSimulink®で作ってみた
【FPGAテストベンチ/検証ノウハウ】テストベンチTEXTIOの使い方 (VHDL編)
Zynq® UltraScale+™ MPSoCにおける U-bootを使ってeMMCデバイスを書き込む方法(TFTP編)
【Versal™ACAP】機能紹介 NoC編(2)
簡単に始めるFPGA電源見積と電源選定
【回路設計ヒント】FPGAの端子と回路図の接続信号との確認方法
【新人ブログ ミンガラバー】VHDL初級編 part.3 ~順序回路~
【FPGAテストベンチ/検証ノウハウ】テストベンチによるクロック信号/リセット信号の生成(Verilog編)
リチウムイオンバッテリモデルをSimulink®で作ってみた 【第3回】SOCを変数とする近似式でEocv, R, Cを表現するモデル編
最近の記事
タグ
- FPGA (262)
- 設計 (198)
- 検証 (105)
- Vivado (80)
- 受付終了 (71)
- ModelSim (52)
- 半導体 (46)
- AI (40)
- メモリ (33)
- Micron (30)
- QuestaSim (29)
- MPSoC (28)
- Vitis (24)
- モデルベース開発 (20)
- Versal (20)
- Vitis AI (20)
- 電源 (19)
- アナログ回路 (18)
- SystemVerilog (18)
- Simulink (16)
- SSD (15)
- サーバ/ストレージ (13)
- IoT (10)
- Nexperia (10)
- 受付中 (9)
- GPU (9)
- アサーション (8)
- 5G (7)
- クロック (7)
- VoIP (7)
- MPS (7)
- ディスクリート/ロジック (6)
- So-One (5)
- SiTime (5)
- Verilog (5)
- 【シリーズ】VHDL初級編 (5)
- 映像伝送 (4)
- 組み込みLinux (4)
- CDC (4)
- イーサネット (3)
- マイコン (3)
- PCIe (3)
- Microchip (3)
- クラウド (3)
- シリアル通信 (3)
- Questa Lint (3)
- MaxLinear (3)
- カメラ (2)
- Haivision (2)
- ティアフォー (2)





